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第3章 组合逻辑电路 第3章测验

1、 问题:一组合电路输入信号的变化顺序有以下三种情况,当      时,将可能出现竞争冒险。
选项:
A:00→01→11→10
B:00→01→10→11
C:00→10→11→01
D:00→10→11→00
答案: 【00→01→10→11

2、 问题:串行加法器进位信号采用     传递,而并行加法器的进位信号采用    传递。
选项:
A:超前,逐位
B:逐位,超前
C:逐位,逐位
D:超前,超前
答案: 【逐位,超前

3、 问题:
选项:
A:110
B:011
C:101
D:111
答案: 【110

4、 问题:一个十六路数据选择器,其地址输入端有         个。
选项:
A:16
B:8
C:2
D:4
答案: 【4

5、 问题:采用4位比较器7485对两个四位二进制数进行比较时,先比较      位。
选项:
A:最低
B:次高
C:次低
D:最高
答案: 【最高

6、 问题:4线-10线译码器中输出状态只有F2=0,其余输出端均为1,则它的的输入状态应取     
选项:
A:0011
B:1000
C:0010
D:1001
答案: 【0010

7、 问题:在下列逻辑电路中,是组合逻辑电路的有_____。
选项:
A:译码器
B:编码器
C:全加器
D:具有反馈性能的寄存器
答案: 【译码器;
编码器;
全加器

8、 问题:门电路的延时时间是产生组合逻辑电路竞争与冒险的唯一原因。
选项:
A:正确
B:错误
答案: 【错误

9、 问题:数据分配器的结构与数据选择器相反,它是一种1路输入,多路输出的逻辑电路。从哪一路输出取决于地址控制端。
选项:
A:正确
B:错误
答案: 【正确

10、 问题:使能端的作用是克服竞争冒险和功能扩展。
选项:
A:正确
B:错误
答案: 【正确

11、 问题:清除竞争冒险的常用方法有(1)电路输出端加           ;(2)输入加        ;(3)增加              。(作答请用顿号“、”间隔)
答案: 【电容、选通脉冲、冗余项

12、 问题:一个有使能端的译码器作数据分配器时,将数据输入端信号连接在       。
答案: 【使能端

第2章 逻辑门电路 第2章测验

1、 问题:ECL逻辑门电路电压摆率为
选项:
A: 0.8V
B:3.3V
C:5V
D:30V
答案: 【 0.8V

2、 问题:TTL电路时间延迟的主要原因是由载流子的聚集和消散引起的,CMOS反相器产生传输延迟的主要原因是由于集成电路                   。
选项:
A:反相器
B:内部电阻和容性负载
C:电阻
D:电源
答案: 【内部电阻和容性负载

3、 问题:CMOS非门是由一个NMOS和一个PMOS组成,其栅极相连作为输入,漏极相连作为输出,NMOS源极需接     电平,PMOS源极接     电平。
选项:
A:高、低
B:高、高
C:低、高
D:低、低
答案: 【低、高

4、 问题:双极型TTL两种载流子工作的电流控制器件在抗幅射能力方面比单极型CMOS一种载流子工作的电压控制器件       。因为射线辐射对           浓度影响不大。
选项:
A:弱、多子
B:强、少子
C:弱、少子
D:强、多子
答案: 【弱、多子

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