2020 FPGA应用开发(上海电力大学) 最新满分章节测试答案

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本课程起止时间为:2020-02-24到2020-06-30
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第一章 绪论 测试单元测验

1、 问题:本次测试是否能够正常观看课程视频？
选项：
A:是的
B:不能
C:无
D:无
答案: 【是的】

2、 问题:是否能够正常使用作业、讨论、慕课堂
选项：
A:是的
B:不能
C:无
D:无
答案: 【是的】

【作业】第一章 绪论 测试单元作业

1、 问题:你是否已登录慕课堂，并为已认证用户，你的用户名是什么
评分规则: 【 是的
】

【作业】第一章 绪论 系统测试作业

1、 问题:你是否登录慕课堂，并为已认证用户，你的用户名是什么？
评分规则: 【 已经登录，已经为认证用户，用户名是学号
】

2、 问题:请把你的昵称改为学号，能修改好吗？
评分规则: 【 可以
】

第一章 绪论 课程系统测验

1、 问题:本次系统测试是否能正常观看课程视频？
选项：
A:可以
B:不可以
C:无
D:无
答案: 【可以】

2、 问题:能否正常使用作业、讨论、慕课堂
选项：
A:能
B:否
C:否
D:否
答案: 【能】

第一章 绪论 第2次系统测验

1、 问题:本次新冠疫情的重灾区是（）。
选项：
A:湖北
B:上海
C:西藏
D:新疆
答案: 【湖北】

2、 问题:疫情期间出门应该（）。
选项：
A:戴口罩
B:戴手套
C:与人保持1米以上距离
D:与人握手
答案: 【戴口罩;
戴手套;
与人保持1米以上距离】

【作业】第二章 Verilog HDL语言 第二章 单元作业

1、 问题:写出产生下图所示波形的变量BullsEye的初始化语句。
评分规则: 【 评分指导： 考查对Verilog中变量初始化的书写。得分标准： 语句发生错误或缺少时延酌情扣分。
】

2、 问题:使用数据流描述方式编写下图所示的异或逻辑的Verilog HDL描述，并使用规定的时延。
评分规则: 【 评分指导： 考查对Verilog中数据流及时延的书写。得分标准： 语句发生错误或缺少时延酌情扣分。
】

3、 问题:用本章讲述的模块FA编写执行加法和减法的4位ALU的结构模型。
评分规则: 【 评分指导： 考查Verilog代码中模块调用的掌握情况。得分标准： ALU模块是否能够完成要求的功能，在进行FA模块调用时书写是否正确。
】

4、 问题:产生一个高电平持续时间和低电平持续时间分别为3 ns和10 ns的时钟。
评分规则: 【 评分指导： 重点考查对Verilog时钟的书写能力。得分标准：根据书写语句是否合法及是否实现时钟要求，酌情评分。
】

【作业】第三章 集成开发环境 第三章 单元作业

1、 问题:什么是功能仿真？主要目的是什么？
评分规则: 【 评分指导：本题考查对FPGA功能仿真的熟悉程度。得分标准：答出功能仿真给3分，答出其主要目的给7分答案：前仿真也叫RTL级行为仿真、功能仿真，目的是分析电路的逻辑关系的正确性，仿真速度快，可以根据需要观察电路输入输出端口和电路内部任一信号和寄存器的波形。
】

2、 问题:testbench代码与源代码最本质的区别是什么？
评分规则: 【 评分指导：本题考查对testbench的掌握程度。得分标准： 准确给出testbench与源代码的区别给10分。答案：testbench代码构造了针对源代码的仿真环境，包括测试激励和输出校验，不需要可综合。源代码是在FPGA上实现的电路抽象描述，必须是可综合的。
】

3、 问题:在testbench中建立仿真的全局复位信号和100MHz的输入时钟信号，写出相应的verilog代码。
评分规则: 【 评分指导：本题考查在testbench中建立仿真语言的能力。得分标准：写出全局复位信号和输入时钟信号给10分。其他酌情减分。答案：initial begin            CLK_IN=0;            nRST    =0;            #100;            nRST    =1;endparameter tPERIOD =10;initial     CLK_IN=0;always     # (tPEIROD/2) CLK_IN = ~ CLK_IN;
】

第三章 集成开发环境 第三章 单元测验

1、 问题:FPGA的仿真环节不包括是（）。
选项：
A:功能仿真
B:翻译后仿真
C:布局布线后仿真
D:在线仿真
答案: 【在线仿真】

2、 问题:关于ModelSim功能仿真说法错误的是（）。
选项：
A:忽略源代码中的时延语句
B:仿真文件没有输入输出端口描述
C:可以构造符合语法规范的任意模型描述
D:例化源文件的顶层Module
答案: 【忽略源代码中的时延语句】

3、 问题:ModelSim软件是一款强大的仿真软件，具有速度快、精度高和便于操作的特点，此外还具有代码分析能力，可以看出不同代码段消耗资源的情况，其功能侧重于编译和仿真，但不能制定编译的器件和下载配置的能力，所以需要和ISE等软件关联使用。
选项：
A:正确
B:错误
答案: 【正确】

4、 问题:语句`timescale 1ns/1ps中，仿真的精度是        。
答案: 【1ps】

5、 问题:面向Virtex-7系列的Xilinx集成开发环境叫做       。
答案: 【Vivado】

【作业】第0章 测试章节 单元作业1

1、 问题:请列出本次线上教学测试中出现的问题。答案保存成word上传。
评分规则: 【 网速慢，进不去
手机看不到作业和测验
签到成功但老师端显示未签到
】

第0章 测试章节 单元测试1

1、 问题:今年是哪一年？（）‍
选项：
A:2021
B:2020
C:2022
D:2023
答案: 【2020】

2、 问题:上海电力大学电子与信息工程学院有哪几个专业？（）‍
选项：
A:电科
B:电子信息
C:通信
D:光电
答案: 【电科;
电子信息;
通信;
光电】

3、 问题:本校线上教学于2020年3月9日开始。
选项：
A:正确
B:错误
答案: 【正确】

4、 问题:你所在学院的全称是                    。
答案: 【电子与信息工程学院】

【作业】第二章 Verilog HDL语言 2.1作业

1、 问题:1.     模块由哪几个部分组成？哪几个部分必须出现？端口分为几种？
评分规则: 【 模块声明、端口定义、信号类型说明、逻辑功能描述。
只有module、模块名和endmodule必须出现。
端口分为三种：输入端口、输出端口、双向端口。
】

2、 问题:将十进制数123用8位二进制数表示出来，使用“_”增加可读性
评分规则: 【 8’b0111_1011
】